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FPGA与DSP联合应用

   班级规模及环境--热线:4008699035 手机:15921673576( 微信同号)
       坚持小班授课，为保证培训效果，增加互动环节，每期人数限3到5人。注意：本课程一旦开课不予退费。
   时间地点
上课地点：【上海】：同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】：电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】：北京中山学院/福鑫大楼 【南京分部】：金港大厦(和燕路) 【武汉分部】：佳源大厦（高新二路） 【成都分部】：领馆区1号（中和大道） 【沈阳分部】：沈阳理工大学/六宅臻品 【郑州分部】：郑州大学/锦华大厦 【石家庄分部】：河北科技大学/瑞景大厦 【广州分部】：广粮大厦 【西安分部】：协同大厦
最近开课时间(周末班/连续班/晚班）：FPGA和DSP联合班：2024年11月18日
   学时和费用
        ★课时： 共一个月

        
        ☆注重质量
        ☆边讲边练
        ☆合格学员免费推荐工作

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   质量保障

        1、培训过程中，如有部分内容理解不透或消化不好，可免费在以后培训班中重听；
        2、培训结束后免费提供半年的技术支持，充分保证培训后出效果；
        3、培训合格学员可享受免费推荐就业机会。
　  课程大纲:

FPGA与DSP联合应用

FPGA与DSP联合应用
课程简介： DSP应用是展示FPGA优势的最有效场合。通过本次课的学习，可以帮助学员掌握使用FPGA实现DSP的基本理论和实现方法。掌握针对DSP的Verilog编程方法，实现如Cordic算法、FFT IP Core使用等经典内容。
培训时长： 四天
必备条件： 熟练掌握Verilog HDL
获得技能： 掌握使用FPGA实现DSP的基本理论和实现方法。
课程大纲： 第一阶段
Verilog for DSP
第二阶段
Cordic算法实现
第三阶段
浮点算法的定点处理
第四阶段
浮点数与定点数
第五阶段
浮点如何转定点
第六阶段
FPGA实现DSP的优势及应用的典型场合
第七阶段
多速率信号处理(中频数字化的理论)
第八阶段
带通采样定理
第九阶段
内插与抽取
第十阶段
FFT IP Core的使用方法
第十一阶段
FPGA+DSP架构分析

 
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